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具体介绍了单稳态电路的特点及实现原理,详细阐述了用Verilog HDL进行编写设计的过程,同时在quartus II 9.0中新建工程进行编译仿真,给出功能仿真的波形,并将该工程下载到FPGA硬件板上,得到的运行结果与功能仿真的结果相同,验证了该设计的正确性。
一种基于Verilog HDL的可重触发单稳态电路的实现
【摘 要】
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具体介绍了单稳态电路的特点及实现原理,详细阐述了用Verilog HDL进行编写设计的过程,同时在quartus II 9.0中新建工程进行编译仿真,给出功能仿真的波形,并将该工程下载到FPG
【机 构】
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福建省计量科学研究院,福建福州,350003
【出 处】
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科协论坛：下半月
【发表日期】
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2004年期
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