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为了解决微处理器设计中时序验证和性能优化问题,采取可综合代码设计到静态时序分析过程中针对关键路径进行处理的策略,完成了系统性能优化的完整流程。理论分析和实践结果证明,根据RTL级的静态时序分析结果进行系统关键路径的优化,可显著提高微处理器的总体性能,减少设计的迭代次数,缩短了设计的周期。
微处理器设计中的时序验证及优化
【摘 要】
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为了解决微处理器设计中时序验证和性能优化问题,采取可综合代码设计到静态时序分析过程中针对关键路径进行处理的策略,完成了系统性能优化的完整流程。理论分析和实践结果证
【机 构】
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福州大学物理与信息工程学院
【出 处】
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现代电子技术
【发表日期】
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2012年8期
【基金项目】
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福建省科技重大专题专项目（2009HZ0003-12010HZ0004-1）, 福建省科技厅重大专项（2011H6015）
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