【摘 要】
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本文在论述频率合成器设计的一般原则与步骤的基础上,从计算合成器输出相位噪声指标入手,来选择环路最佳参数ζ、ω_0,并对一个采用取样保持鉴相器与吞脉冲分频器的典型数字
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本文在论述频率合成器设计的一般原则与步骤的基础上,从计算合成器输出相位噪声指标入手,来选择环路最佳参数ζ、ω_0,并对一个采用取样保持鉴相器与吞脉冲分频器的典型数字式频率合成器环路进行了详细的工程设计,所使用的方法与步骤对设计其它类型的频率合成器同样适用。
Based on the general principles and steps of the frequency synthesizer design, this paper starts with calculating the output phase noise index of the synthesizer to choose the best parameter of the loop ζ, ω_0, and uses a sample-and-hold phase detector and swallow pulse The typical digital frequency synthesizer loop of the frequency converter is detailedly engineered using the same methods and procedures as other types of frequency synthesizers.
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