K—9卷积码的Viterbi译码算法及其FPGA实现

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探讨了CDMA数字移动通信中的差错控制问题,研究用约束度K=9的卷积编码和最大似然Viterbi译码的差错控制方案。在Viterbi译码算法中,提出了原位运算度量、保存路径转移过程和循环存取幸存路径等方法,能有效地减少存储量、降低功耗,使得K=9的Viterbi译码算法可以单片XC4010 FPGA为主的器件上实现,其性能指标符合CD-MA数字移动通信IS-95标准要求。文中给出了实测的算法性能,
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