【摘 要】
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介绍了一种智能变电站合并单元的设计方案,采用现场可编程逻辑阵列(FPGA)作为硬件框架,充分利用FPGA的模块化编程和多任务处理的特点,通过在FPGA芯片上配置NiosII软核处理器
【机 构】
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甘肃省工业过程先进控制重点实验室,兰州理工大学电气工程与信息工程学院
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介绍了一种智能变电站合并单元的设计方案,采用现场可编程逻辑阵列(FPGA)作为硬件框架,充分利用FPGA的模块化编程和多任务处理的特点,通过在FPGA芯片上配置NiosII软核处理器和相关接口,完成合并单元采样脉冲同步、数据采集及处理,将数据按照IEC61850-9-2标准组帧通过以太网与过程层设备通信发送至过程层设备。运用MMS Ethereal软件对本合并单元输出的电压、电流信号进行测试,结果表明该合并单元所送数据与接收数据一致,符合9-2标准。本装置可以实现了合并单元多任务、大信息量及实时高通速信的要求,具有较强的实用价值。
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