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为解决上位机软件进行中值滤波算法对安检图像预处理速度有限问题,针对探测器的数据发送方式,利用现场可编程门阵列(FPGA)的并行处理能力,对中值滤波算法进行流水线设计,并通过硬件描述语言Verilog进行设计实现。实验证明,改进的算法在处理速度上比传统的冒泡算法提高了70%左右。
探测器图像中值滤波算法的FPGA设计与实现
【摘 要】
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为解决上位机软件进行中值滤波算法对安检图像预处理速度有限问题,针对探测器的数据发送方式,利用现场可编程门阵列(FPGA)的并行处理能力,对中值滤波算法进行流水线设计,并通过硬件描述语言Verilog进行设计实现。实验证明,改进的算法在处理速度上比传统的冒泡算法提高了70%左右。
【机 构】
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北华航天工业学院电子与控制工程学院
【出 处】
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北华航天工业学院学报
【发表日期】
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2017年05期
【基金项目】
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北华航天工业学院科研项目（KYPT-2014-01）,河北省科技厅科研项目（15210131）
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针对探测器的数据采集方式,通过利用现场可编程门阵列(FPGA)的并行处理能力,依据"面积换取速度"的原则,对直方图均衡化算法进行FPGA优化设计。通过Model Sim和MATLAB仿真实验,验证了优化设计算法的正确性,并将处理速度提升了一倍,同时简化了逻辑结构和外部资源的使用。
目的：探讨肺保护性通气策略治疗急性呼吸窘迫综合征的效果,为临床救治ARDS提供参考。方法：选取2013年3月至2015年8月我院以保护性肺通气策略治疗的58例ARDS患者作为观察组,选取