【摘 要】
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提出一种表达式粒度可重构阵列的VLSI架构,主要面向具有高计算密集度和高数据并行度的应用,如视频编解码.每个处理单元内部包含4个异构数据通路单元,能够映射一个运算表达式,
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提出一种表达式粒度可重构阵列的VLSI架构,主要面向具有高计算密集度和高数据并行度的应用,如视频编解码.每个处理单元内部包含4个异构数据通路单元,能够映射一个运算表达式,处理单元之间采用三层互联结构.阵列内部包括128位带宽的数据存储模块,具有数据乱序分发和拼接能力,核心计算循环能够映射到可重构阵列上执行.对包含16个处理单元的架构原型进行建模,采用TSMC 90nm工艺综合,工作频率达100MHz,芯片面积为1.38mm2.对2D-DCT算法进行性能比较,结果显示该架构具有更好的计算资源利用率和面积效率
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