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时延故障对高速运算电路性能有着关键性的影响,本文对高速加法器之一的条件和加法器的通路时延故障作了研究。首先对其提出了一种......
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对时延故障测试提出了一种采用累加器实现测试序列生成的方案.该方案通过对累加器作可测性设计,并复用其硬件电路,所生成的测试序......
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