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设计了一个用于Delta-Sigma ADC内部降采样的数字滤波器，滤波器采用CIC与三个半带滤波器级联的结构，通过MATLAB的模型仿真表明，ADC的模拟调制器通此滤波器输出信号的信噪比大于100dB，功能已经用Verilog语言实现并在FPGA上验证通过。
Delta-Sigma降采样数字滤波器设计
【摘 要】
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设计了一个用于Delta-Sigma ADC内部降采样的数字滤波器，滤波器采用CIC与三个半带滤波器级联的结构，通过MATLAB的模型仿真表明，ADC的模拟调制器通此滤波器输出信号的信噪比大于100dB，功能已经用Verilog语言实现并在FPGA上验证通过。
【机 构】
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电子科技大学微固学院 成都 610054
【出 处】
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2009四川省电子学会半导体与集成技术专委会学术年会
【发表日期】
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2009年3期
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