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以X264编码器作为研究对象，在指令集并行的基础上对其进行线程级并行优化，在Intel双核处理器平台上，针对非实时编码应用得到近2倍的加速比，针对实时编码应用得到1．5倍的加速比。
H．264并行编码算法的研究
【摘 要】
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以X264编码器作为研究对象，在指令集并行的基础上对其进行线程级并行优化，在Intel双核处理器平台上，针对非实时编码应用得到近2倍的加速比，针对实时编码应用得到1．5倍的加速比。
【机 构】
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上海交通大学图像通信与信息处理研究所电子工程系、上海数字媒体处理与传输重点实验室
【出 处】
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电视技术
【发表日期】
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2008年2期
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