乘累加相关论文
充分利用FPGA资源丰富、处理灵活等优势，采用FPGA技术实现了高带宽、高精度的DBF系统，能够与DSP系统互通，接收来自DSP系统的权值。系......
本文以Xilinx的Virtex.ⅡPro系列的XC2VP20芯片为例，详细介绍了一种新的时域数字脉压方法。它利用FPGA内部的块RAM进行数据缓存，硬核......
微电子技术突飞猛进，工艺特征尺寸已减小到0.18微米以下，0.13微米的工艺已经成熟。基于集成电路工艺的提升，代表集成电路发展水平的微......
1.序言rn一般来讲,在用可编程DSP实现的通信和信号处理算法中需要计算两个定点数的除法.除法可以通过先计算除数的倒数,然后与被除......
本文设计了扩展的乘累加单元（DSPMAC）,用于运算速度的提高。基于or1200乘累加单元,运用RISC技术和并行操作,通过开发32-bit指令中的......
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提出一种在FPGA中以CIC抽取滤波器及CIC补偿滤波器实现的抽取滤波结构．该结构以时间换空间的设计思想实现，最大可能的减少了硬核乘法......
针对传统的FIR滤波器的缺点，介绍了一种基于FPGA乘法器的FIR滤波器设计方法，该滤波器利用FPGA自带的18位乘法器MULT18×18SIO进......
稀疏矩阵向量乘（Sparse Matrix—Vector Multiply，SMVM），形如Ab=x，在科学计算、信息检索、数据挖掘等领域中部是重要的计算核心之一。稀......
System Generator是一款新型的FPGA辅助设计工具.本文首先简要介绍了System Generator的主要特色及设计流程,并以一个64阶的FIR滤......
通过对目前现有的反向采样法、正交采样法、四等分累加法等数字相敏检波进行深入研究，提出了一种基于数字信号处理的数字相敏检波算......
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衡量DSP(数字信号处理器)芯片性能的一个重要指标是单位时间内能够完成乘累加操作的数量。乘累加速度的增加就会使得DSP芯片运算速......
Xilinx和Intel生产的许多先进现场可编程门阵列(Field Programmable Gate Array,FPGA)中,通常采用具有较高的固定位宽乘法器的数字......
针对目前浮点运算单元在处理向量点乘运算时存在数据相关性的问题，提出一种低延迟单周期的累加单元结构。该结构用于7级流水的可配......
异步电路能很好地解决同步集成电路设计中出现的时钟扭曲和时钟功耗过大等问题。本文采用异步集成电路设计方法设计了一款32位异步......
