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简单介绍了全数字锁相环（ADPLL）的结构和工作原理，提出一种在FPGA的基础上可增大全数字锁相环同步范围的设计方法，并给出了部分verilog HDL设计程序的代码和仿真波形。
基于FPGA的全数字锁相环的设计
【摘 要】
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简单介绍了全数字锁相环（ADPLL）的结构和工作原理，提出一种在FPGA的基础上可增大全数字锁相环同步范围的设计方法，并给出了部分verilog HDL设计程序的代码和仿真波形。
【机 构】
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河北大学电子信息工程学院
【出 处】
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电子设计工程
【发表日期】
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2009年1期
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