基于CPLD的卷积码编解码器的设计

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【摘要】

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卷积码是一种性能优良的差错控制编码.本文阐述了卷积码编解码器的基本工作原理,在MAX+PLUS2软件平台上,给出了利用复杂可编程逻辑器件设计的(2,1,6)卷积码编解码器电路,并进

【作者】

：

龙光利

【机构】

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723003

【出处】

：

微计算机信息

【发表日期】

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2007年23期

【关键词】

：

卷积码编码器解码器复杂可编程逻辑器件 convolutional- code encoder decoder CPLD

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卷积码是一种性能优良的差错控制编码.本文阐述了卷积码编解码器的基本工作原理,在MAX+PLUS2软件平台上,给出了利用复杂可编程逻辑器件设计的(2,1,6)卷积码编解码器电路,并进行了编译和波形仿真.综合后下载到复杂可编程逻辑器件EPM7128SLC84-15中,测试结果表明,达到了预期的设计要求.

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